2025年1月5日 · DDRC（Dynamic Data Rate Controller），主要就是起到一个对于DDR的控制的作用，负责把MASTER发送过来的命令，转换成DDR认识的命令。 通俗点说，就是起到了一个翻译的作用。 我们找两个DDRC的设计方案： 上面的一张图中，只包含DDRC，下面的图中，左侧是DDRC，右侧是DDRPHY。 我们暂时只关注DDRC的部分，可以看到，对于DDRC与MASTER之间的接口支持的是AXI接口，这对于开发者来说就非常友好了。 对于DDRC与后级（也就 …

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2025年1月5日 · DDR Core and Transaction Scheduler (DDRC)是内存管理系统中一个关键组件，它主要负责管理和调度对DDR（Double Data Rate，双倍数据率）内存的读写操作。 这个组件对于确保系统能够高效地访问内存至关重要，特别是在处理多个并发内存请求时。

2024年7月29日 · 它将来自控制器的数据包，转换成DDR接口电气特性、时序特性的信号，送给对端器件DDR，也负责将DDR返回的数据转成控制器对应的数据包。 到这里是不是有感觉了？ DDRC将来自AXI的命令转成对应DDRC数据包，PHY再将DDRC数据包转成DDR能识别的时序信号。 但是DDRPHY就做个数据转换？ 那肯定不是！ 首先说说兼容性，一个PHY一般会支持多个协议，对接不同的DDR，其次是支持扩容对吧，前面我们DDRC说了支持，那DDRPHY肯定需 …

2022年7月24日 · Setting DDRC (PORTC direction) to 0x3F (B00111111) sets all six pins to output. 0xAA = B10101010 and 0x55 = B01010101. Toggling between the two will alternatively toggle all PORTC pins.

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2018年6月8日 · 本文介绍了DDR内存的关键概念，包括通道 (channel)、DDR控制器 (DDRC)、双列直插式内存模块 (DIMM)、存储芯片 (chip)、颗粒 (rank)及存储单元 (bank)等，帮助读者更好地理解DDR内存的工作原理。 我们经常听到DDR相关一些词语，比如DIMM，但不知道什么意思，这两天刚好看了一下， 终于有点理解了，这里做一些总结。 channel：也就是 通道，简单理解就是DDRC (DDR控制器)，一个通道对应一个DDRC。 芯片支持多少个DDRC就支持多少个通道。 …

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Table: DDRI Registers Overview shows an overview of DDRC registers. Table 10-11: DDRI Registers Overview Function Hardware Register Name Dynamic Bit Fields Description Status mode_sts_reg ~ Controller operation mode status Transaction Scheduler HPR_reg ~ HPR queue control LPR_reg ~ LPR queue control WR_reg ~ WR queue c...