2025年1月5日 · DDRC（DDR控制器）：负责处理内存访问的逻辑，管理数据的流入和流出，处理数据缓存、行开/关（Row Open/Close）、命令调度等高层逻辑操作。 DDRPHY（DDR物理层）：则处理低层次的电信号转换和传输，确保信号在内存控制器和DDR芯片之间以高速度和稳定性传输。 它还负责处理时钟、信号完整性和电源管理等。 其中DDRC（Dynamic Data Rate Controller）和 DDRPYH（DDR Physical Layer）通常作为一个整体的设计方案出现，它并不 …

2024年7月29日 · DDR Core and Transaction Scheduler (DDRC)是内存管理系统中一个关键组件，它主要负责管理和调度对DDR（Double Data Rate，双倍数据率）内存的读写操作。这个组件对于确保系统能够高效地访问内存至关重要，特别是在处理多个并发内存请求时。_ddrc

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2025年2月14日 · 本文依据的是xilinx的PG150文档，主要介绍的是xilinx的ultrascale系列中内存资源的使用。 Xilinx UltraScale™架构中的DDR3/DDR4 SDRAM ip核旨在支持高性能的内存接口解决方案。 这些ip可以用于将DDR3和DDR4 SDRAM内存类型集成到设计中，提供完整的内存控制器和物理层（PHY）解决方案。 下面是该ip的大致架构： 可以看到在xilinx提供的DDR操作方案中，大致的设计方向与我们之前讨论的方式是一致的。 同样是包含了DDRC（图中的Memory …

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Table: DDRI Registers Overview shows an overview of DDRC registers. Table 10-11: DDRI Registers Overview Function Hardware Register Name Dynamic Bit Fields Description Status mode_sts_reg ~ Controller operation mode status Transaction Scheduler HPR_reg ~ HPR queue control LPR_reg ~ LPR queue control WR_reg ~ WR queue c...

2024年7月29日 · 它将来自控制器的数据包，转换成DDR接口电气特性、时序特性的信号，送给对端器件DDR，也负责将DDR返回的数据转成控制器对应的数据包。 到这里是不是有感觉了？ DDRC将来自AXI的命令转成对应DDRC数据包，PHY再将DDRC数据包转成DDR能识别的时序信号。 但是DDRPHY就做个数据转换？ 那肯定不是！ 首先说说兼容性，一个PHY一般会支持多个协议，对接不同的DDR，其次是支持扩容对吧，前面我们DDRC说了支持，那DDRPHY肯定需 …

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2024年3月19日 · 这个模组主要是为了给没有基础的mcreator作者提供参考。 该mod使用mcreator2023.4，blockbench以及Aseprite制作。